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[F4] LTDC时钟频率

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发表于 6 天前 | 显示全部楼层 |阅读模式
本帖最后由 天眼 于 2018-12-6 15:49 编辑

L(G0(0[Y8SP2Z3))6PV_UCT.png 火哥,想问一下图片中这个8.75Mhz,怎么测得,这个数据是不是和SDRAM刷新频率有关


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发表于 6 天前 | 显示全部楼层
那个函数注释有说明的
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 楼主| 发表于 5 天前 | 显示全部楼层
巢易白 发表于 2018-12-6 17:16
那个函数注释有说明的

        /* 配置 PLLSAI 分频器,它的输出作为像素同步时钟CLK*/
  /* PLLSAI_VCO 输入时钟 = HSE_VALUE/PLL_M = 1 Mhz */
  /* PLLSAI_VCO 输出时钟 = PLLSAI_VCO输入 * PLLSAI_N = 416 Mhz */
  /* PLLLCDCLK = PLLSAI_VCO 输出/PLLSAI_R = 420/6  Mhz */
  /* LTDC 时钟频率 = PLLLCDCLK / DIV = 420/6/8 = 8.75 Mhz */
        /* LTDC时钟太高会导花屏,若对刷屏速度要求不高,降低时钟频率可减少花屏现象*/
        /* 以下函数三个参数分别为:PLLSAIN,PLLSAIQ,PLLSAIR,其中PLLSAIQ与LTDC无关*/
函数注释只是说明了怎么配置成8.75MHZ,以及频率过高时会出现花屏,但是我想问的是8.75MHZ是怎么测出来的,有没有什么原理或依据,
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