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[xilinx] 顶层例化中 同一个 output 类型的引脚被多个子模块引用

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发表于 2022-3-21 16:56:25 | 显示全部楼层 |阅读模式
请问一下,在读、写flash的章节中,老师将 全擦除flash模块、读flash模块、写flash模块 这三个模块都单独编写出来,

这三个模块的输出output都包含spi通信引脚:cs_n、sck、mosi。

我在实际的工程中,在顶层例化模块中,只输出一组  cs_n、sck、mosi。

那么在顶层例化文件中,该输出信号怎么同时被3个模块引用呢?


非常感谢
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发表于 2022-3-22 08:53:49 | 显示全部楼层
不能同时进行读写,如果要在同一个工程下控制,就要分时进行
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